NCP1578
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be connected to either PGND or AGND but not on
the both.
4.The ground terminals of input and output
capacitors, and the low-side MOSFET's source
pin should be connected to PGND ground plane
through (if necessary) multiple vias.
5.Noise sensitive traces such as traces of FB, COMP
and OCSET should be placed in order to prevent
from interference of high voltage switching signal
traces like SWN, VBST, TG and BG.
6.The feedback resistor divider should be placed as
close as possible to FB pin. The output voltage
sensing signal should be come up from the
separated noise free signal trace.
7.To minimize the effect of parasitic impedance,
traces between gate drivers to MOSFET's gates
should be as shortest as possible.
1
PGND
PGDLY
PGOOD
SS
COMP
OCSET
FOFF
EN_SW
FPWM
EN_LDO
2
3
4
5
6
7
8
9
10
15
14
13
12
11
20
19
18
17
16
L1
VO
3.3V, 5A
Cbst
0.1uF
NCP1578NMR2
Ccmp1
680pF
Ccmp2
2.7nF
Rcmp
2.7k
Cfb
10nF
100
Rfb1
Rfb2a
5.6k
Rfb3
1.8k
Cldo
1uF
Rldo
10
Ren_ldo
100k
Roc
4.7k
Coc
10nF
Css
82nF
Cpgdly
18nF
Cin1
10uF
Cin2
0.1uF
AGND PGND
M1
NTMS7N03R2
NTMS7N03R2
M2
2.2uH
Co1
180uF
Co2
180uF
Co3
1uF
D1
MBRM120L
Dbst
MBR0530T1
PGOOD
EN_SW
FPWM
Cvccp
1uF
Cvbat
1uF
VBAT
U1
Figure 37. Typical Application Schematic Diagram
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